品牌

无推荐品牌

型号

无推荐型号

技术规格及参数

1、服务内容：
(1)提供基于UMC * nm eFlash (略) 理芯片的Chip TOP整合RTL设计与仿真：将SPI与Analog IP 、IO整合在 * 起。
(2)实现如下规格的SPI功能设计：
SPI 模式：SPI slave
工作频率： * M
数据线数目： * 根
工作模式：时钟上升沿读取数据，下降沿发送数据
功能：读写 * 个配置寄存器
(3)进行SOC block 和chip level 中 (略) 分的仿真验证。
(4)Chip level synthesis。
(5)提供于UMC * nm eFlash 工艺的ADC、DAC、Verifier、PMU等IP的模拟电路版图设计服务。
2、 验收条件：
(1)IP基于UMC * eFlash平台工艺。
(2)IP 规格可以实现如下功能：
SPI 模式：SPI slave
工作频率： * M
数据线数目： * 根
工作模式：时钟上升沿读取数据，下降沿发送数据
(3)TOP整合 (略) 理芯片仿真验证功能。
(4)模拟版图设计后的GDS与ADC、DAC、Verifier、PMU的原理图对应 * 致。

售后及质保要求

1、成交供应商必须保证提交GDS的DRC验证、LVS验证结果的真实性和准确性，以及验证结果的可重复性。
2、成交供应商自中标日起， (略) 内容的技 (略) 服务。
3、成交供应商自中标日起， * 年内免费提供该项目的基于SPI IP项目的 (略) 服务。
4、成交供应商提供fab的WAT报告，保证芯片生产后工艺偏差在fab生产标准范围内。
5、成交供应商在芯片生产前提供两次免费的ECO。

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1、服务内容：
(1)提供基于UMC * nm eFlash (略) 理芯片的Chip TOP整合RTL设计与仿真：将SPI与Analog IP 、IO整合在 * 起。
(2)实现如下规格的SPI功能设计：
SPI 模式：SPI slave
工作频率： * M
数据线数目： * 根
工作模式：时钟上升沿读取数据，下降沿发送数据
功能：读写 * 个配置寄存器
(3)进行SOC block 和chip level 中 (略) 分的仿真验证。
(4)Chip level synthesis。
(5)提供于UMC * nm eFlash 工艺的ADC、DAC、Verifier、PMU等IP的模拟电路版图设计服务。
2、 验收条件：
(1)IP基于UMC * eFlash平台工艺。
(2)IP 规格可以实现如下功能：
SPI 模式：SPI slave
工作频率： * M
数据线数目： * 根
工作模式：时钟上升沿读取数据，下降沿发送数据
(3)TOP整合 (略) 理芯片仿真验证功能。
(4)模拟版图设计后的GDS与ADC、DAC、Verifier、PMU的原理图对应 * 致。

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1、成交供应商必须保证提交GDS的DRC验证、LVS验证结果的真实性和准确性，以及验证结果的可重复性。
2、成交供应商自中标日起， (略) 内容的技 (略) 服务。
3、成交供应商自中标日起， * 年内免费提供该项目的基于SPI IP项目的 (略) 服务。
4、成交供应商提供fab的WAT报告，保证芯片生产后工艺偏差在fab生产标准范围内。
5、成交供应商在芯片生产前提供两次免费的ECO。