PLL设计服务(ZJLAB-FS-BX20220863)延期公告

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PLL设计服务(ZJLAB-FS-BX20220863)延期公告

项目名称PLL设计服务项目编号ZJLAB-FS-BX*
公告开始日期*公告截止日期*
采购单位之江实验室付款方式合同签订后付款70%,验收合格后付款30%。
联系人中标后在我参与的项目中查看联系电话中标后在我参与的项目中查看
签约时间要求到货时间要求
预 算*.0
收货地址
供应商资质要求

符合《政府采购法》第二十二条规定的供应商基本条件

采购商品采购数量计量单位所属分类
PLL设计服务1其他服务行业
品牌
型号
品牌2
型号
品牌3
型号
预算*.0
技术参数及配置要求1、基于smic 28nm工艺提供PLL的硬核开发服务; 2、为前端设计工程师提供前端芯片设计所需要的PLL硬核文件,完成逻辑综合的主要流程和验证;3、提供可以完成物理后端的设计的文件,包括lib、lef及partial gds等,满足设计的时序和面积要求,辅助完成版图的floorplan;4、提供硬核的DRC、LVS等检查规范;5、辅助完成最终Tape out 数据的提交和PLL硬核在fab的merge工作,要求PLL硬核使用流片次数不少于3次 ;6、PLL关键指标:1)输入频率:1MHz~1000MHz,2)输出频率:25MHz~2000MHz;3)无需增加其他外围元件;4)工作电压:IO 1.8V, core 0.9V;7、项目周期:30天。
售后服务合同签订日起半年内,免费提供维护和技术支持。;

报价地址:http://**
项目名称PLL设计服务项目编号ZJLAB-FS-BX*
公告开始日期*公告截止日期*
采购单位之江实验室付款方式合同签订后付款70%,验收合格后付款30%。
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技术参数及配置要求1、基于smic 28nm工艺提供PLL的硬核开发服务; 2、为前端设计工程师提供前端芯片设计所需要的PLL硬核文件,完成逻辑综合的主要流程和验证;3、提供可以完成物理后端的设计的文件,包括lib、lef及partial gds等,满足设计的时序和面积要求,辅助完成版图的floorplan;4、提供硬核的DRC、LVS等检查规范;5、辅助完成最终Tape out 数据的提交和PLL硬核在fab的merge工作,要求PLL硬核使用流片次数不少于3次 ;6、PLL关键指标:1)输入频率:1MHz~1000MHz,2)输出频率:25MHz~2000MHz;3)无需增加其他外围元件;4)工作电压:IO 1.8V, core 0.9V;7、项目周期:30天。
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